劉春平-4xDDR3(菊花鏈）

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布線要求
1，走線間距滿足3w，單端阻抗50Ω

2，數(shù)據線每11根走同一層
3，數(shù)據線最大長度盡量不超過2500mil，組內誤差50mil；地址線、控制線、時鐘線組內誤差正負100mil；差分線誤差5mil
4，如果走線交叉嚴重，可以同組網絡交換（注意網絡有交換，一定要告知軟體和硬件工程師）
5，BGA/DDR上的過孔要蓋油,移除尖峰銅皮
6，布局和走線完成后，注意調整絲印